done basic skeleton
This commit is contained in:
parent
13f0d05de5
commit
2b47f19f20
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@ -1 +1,25 @@
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*.zip
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*.zip
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# Compiled class file
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*.class
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# Log file
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*.log
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# BlueJ files
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*.ctxt
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# Mobile Tools for Java (J2ME)
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.mtj.tmp/
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# Package Files #
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*.jar
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*.war
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*.nar
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*.ear
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*.zip
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*.tar.gz
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*.rar
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# virtual machine crash logs, see http://www.java.com/en/download/help/error_hotspot.xml
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hs_err_pid*
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replay_pid*
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||||||
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@ -1,5 +1,8 @@
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||||||
package generic;
|
package generic;
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||||||
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import java.io.FileInputStream;
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||||||
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import java.io.InputStream;
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||||||
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import processor.Clock;
|
import processor.Clock;
|
||||||
import processor.Processor;
|
import processor.Processor;
|
||||||
|
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||||||
|
@ -19,7 +22,6 @@ public class Simulator {
|
||||||
static void loadProgram(String assemblyProgramFile)
|
static void loadProgram(String assemblyProgramFile)
|
||||||
{
|
{
|
||||||
/*
|
/*
|
||||||
* TODO
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|
||||||
* 1. load the program into memory according to the program layout described
|
* 1. load the program into memory according to the program layout described
|
||||||
* in the ISA specification
|
* in the ISA specification
|
||||||
* 2. set PC to the address of the first instruction in the main
|
* 2. set PC to the address of the first instruction in the main
|
||||||
|
@ -28,6 +30,37 @@ public class Simulator {
|
||||||
* x1 = 65535
|
* x1 = 65535
|
||||||
* x2 = 65535
|
* x2 = 65535
|
||||||
*/
|
*/
|
||||||
|
|
||||||
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try (
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||||||
|
InputStream is = new FileInputStream(assemblyProgramFile);
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||||||
|
){
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||||||
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int i = 0;
|
||||||
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byte[] line = new byte[4];
|
||||||
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boolean isFirstLine = true;
|
||||||
|
while(is.read(line) != -1) {
|
||||||
|
int value = 0;
|
||||||
|
for(int j = 0; j < 4; j++) {
|
||||||
|
value = (value << 8) | (line[j] & 0xff);
|
||||||
|
}
|
||||||
|
System.out.println(value);
|
||||||
|
if(isFirstLine) {
|
||||||
|
processor.getRegisterFile().setProgramCounter(value);
|
||||||
|
isFirstLine = false;
|
||||||
|
}else{
|
||||||
|
processor.getMainMemory().setWord(i, value);
|
||||||
|
i++;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
processor.getRegisterFile().setValue(0, 0);
|
||||||
|
processor.getRegisterFile().setValue(1, 65535);
|
||||||
|
processor.getRegisterFile().setValue(2, 65535);
|
||||||
|
|
||||||
|
// Debug
|
||||||
|
System.out.println(processor.getRegisterFile().getProgramCounter());
|
||||||
|
System.out.println(processor.getMainMemory().getContentsAsString(0, 10));
|
||||||
|
} catch (Exception e) {
|
||||||
|
e.printStackTrace();
|
||||||
|
}
|
||||||
}
|
}
|
||||||
|
|
||||||
public static void simulate()
|
public static void simulate()
|
||||||
|
@ -44,6 +77,8 @@ public class Simulator {
|
||||||
Clock.incrementClock();
|
Clock.incrementClock();
|
||||||
processor.getRWUnit().performRW();
|
processor.getRWUnit().performRW();
|
||||||
Clock.incrementClock();
|
Clock.incrementClock();
|
||||||
|
Statistics.setNumberOfInstructions(Statistics.getNumberOfInstructions() + 1);
|
||||||
|
Statistics.setNumberOfCycles(Statistics.getNumberOfCycles() + 1);
|
||||||
}
|
}
|
||||||
|
|
||||||
// TODO
|
// TODO
|
||||||
|
|
|
@ -27,13 +27,22 @@ public class Statistics {
|
||||||
Misc.printErrorAndExit(e.getMessage());
|
Misc.printErrorAndExit(e.getMessage());
|
||||||
}
|
}
|
||||||
}
|
}
|
||||||
|
|
||||||
// TODO write functions to update statistics
|
// TODO write functions to update statistics
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||||||
public void setNumberOfInstructions(int numberOfInstructions) {
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||||||
|
public static int getNumberOfInstructions()
|
||||||
|
{
|
||||||
|
return numberOfInstructions;
|
||||||
|
}
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||||||
|
public static int getNumberOfCycles()
|
||||||
|
{
|
||||||
|
return numberOfCycles;
|
||||||
|
}
|
||||||
|
public static void setNumberOfInstructions(int numberOfInstructions)
|
||||||
|
{
|
||||||
Statistics.numberOfInstructions = numberOfInstructions;
|
Statistics.numberOfInstructions = numberOfInstructions;
|
||||||
}
|
}
|
||||||
|
public static void setNumberOfCycles(int numberOfCycles) {
|
||||||
public void setNumberOfCycles(int numberOfCycles) {
|
|
||||||
Statistics.numberOfCycles = numberOfCycles;
|
Statistics.numberOfCycles = numberOfCycles;
|
||||||
}
|
}
|
||||||
|
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,10 +1,27 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
public class EX_IF_LatchType {
|
public class EX_IF_LatchType {
|
||||||
|
int pc;
|
||||||
|
boolean IF_enable;
|
||||||
|
|
||||||
public EX_IF_LatchType()
|
public EX_IF_LatchType()
|
||||||
{
|
{
|
||||||
|
IF_enable = false;
|
||||||
}
|
}
|
||||||
|
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||||||
|
public boolean isIF_enable() {
|
||||||
|
return IF_enable;
|
||||||
|
}
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||||||
|
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||||||
|
public void setIF_enable(boolean iF_enable) {
|
||||||
|
IF_enable = iF_enable;
|
||||||
|
}
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||||||
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||||||
|
public int getPC() {
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||||||
|
return pc;
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|
}
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|
public void setPC(int pc) {
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|
this.pc = pc;
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||||||
|
}
|
||||||
}
|
}
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||||||
|
|
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@ -1,14 +1,44 @@
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||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
|
import generic.Instruction;
|
||||||
|
import generic.Operand;
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||||||
|
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||||||
public class EX_MA_LatchType {
|
public class EX_MA_LatchType {
|
||||||
|
|
||||||
boolean MA_enable;
|
boolean MA_enable;
|
||||||
|
Operand op2;
|
||||||
|
Instruction instruction;
|
||||||
|
int aluResult;
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||||||
|
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||||||
public EX_MA_LatchType()
|
public EX_MA_LatchType()
|
||||||
{
|
{
|
||||||
MA_enable = false;
|
MA_enable = false;
|
||||||
}
|
}
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||||||
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||||||
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public void setInstruction(Instruction instruction) {
|
||||||
|
this.instruction = instruction;
|
||||||
|
}
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||||||
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public Instruction getInstruction() {
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||||||
|
return instruction;
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||||||
|
}
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public void setOp2(Operand op2) {
|
||||||
|
this.op2 = op2;
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|
}
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||||||
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|
public Operand getOp2(){
|
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|
return op2;
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|
}
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||||||
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||||||
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public void setALUResult(int aluResult) {
|
||||||
|
this.aluResult = aluResult;
|
||||||
|
}
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|
public int getALUResult(){
|
||||||
|
return aluResult;
|
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|
}
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||||||
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||||||
public boolean isMA_enable() {
|
public boolean isMA_enable() {
|
||||||
return MA_enable;
|
return MA_enable;
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,6 +1,9 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
import processor.Processor;
|
import processor.Processor;
|
||||||
|
import generic.Instruction;
|
||||||
|
import generic.Instruction.OperationType;
|
||||||
|
import generic.Simulator;
|
||||||
|
import generic.Operand.OperandType;
|
||||||
|
|
||||||
public class Execute {
|
public class Execute {
|
||||||
Processor containingProcessor;
|
Processor containingProcessor;
|
||||||
|
@ -19,6 +22,106 @@ public class Execute {
|
||||||
public void performEX()
|
public void performEX()
|
||||||
{
|
{
|
||||||
//TODO
|
//TODO
|
||||||
}
|
if(OF_EX_Latch.isEX_enable())
|
||||||
|
{
|
||||||
|
int op1 = OF_EX_Latch.getOp1();
|
||||||
|
int op2 = OF_EX_Latch.getOp2();
|
||||||
|
int imm = OF_EX_Latch.getImm();
|
||||||
|
Instruction instruction = OF_EX_Latch.getInstruction();
|
||||||
|
int cur_pc = containingProcessor.getRegisterFile().getProgramCounter();
|
||||||
|
int alu_result = 0;
|
||||||
|
OperationType alu_op = OF_EX_Latch.getInstruction().getOperationType();
|
||||||
|
switch(alu_op)
|
||||||
|
{
|
||||||
|
case add: alu_result = op1 + op2; break;
|
||||||
|
case addi: alu_result = op1 + imm; break;
|
||||||
|
case sub: alu_result = op1 - op2; break;
|
||||||
|
case subi: alu_result = op1 - imm; break;
|
||||||
|
case mul: alu_result = op1 * op2; break;
|
||||||
|
case muli: alu_result = op1 * imm; break;
|
||||||
|
case div: alu_result = op1 / op2; break;
|
||||||
|
case divi: alu_result = op1 / imm; break;
|
||||||
|
case and: alu_result = op1 & op2; break;
|
||||||
|
case andi: alu_result = op1 & imm; break;
|
||||||
|
case or: alu_result = op1 | op2; break;
|
||||||
|
case ori: alu_result = op1 | imm; break;
|
||||||
|
case xor: alu_result = op1 ^ op2; break;
|
||||||
|
case xori: alu_result = op1 ^ imm; break;
|
||||||
|
case slt: alu_result= (op1 < op2) ? 1 : 0; break;
|
||||||
|
case slti: alu_result= (op1 < imm) ? 1 : 0; break;
|
||||||
|
case sll: alu_result = op1 << op2; break;
|
||||||
|
case slli: alu_result = op1 << imm; break;
|
||||||
|
case srl: alu_result = op1 >>> op2; break;
|
||||||
|
case srli: alu_result = op1 >>> imm; break;
|
||||||
|
case sra: alu_result = op1 >> op2; break;
|
||||||
|
case srai: alu_result = op1 >> imm; break;
|
||||||
|
case jmp:
|
||||||
|
{
|
||||||
|
OperandType optype = instruction.getDestinationOperand().getOperandType();
|
||||||
|
if (optype == OperandType.Register){
|
||||||
|
imm = containingProcessor.getRegisterFile().getValue(
|
||||||
|
instruction.getDestinationOperand().getValue());
|
||||||
|
}
|
||||||
|
else{
|
||||||
|
imm = OF_EX_Latch.getImm();
|
||||||
|
}
|
||||||
|
alu_result = cur_pc + imm;
|
||||||
|
EX_IF_Latch.setIF_enable(true);
|
||||||
|
EX_IF_Latch.setPC(alu_result);
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
case beq:
|
||||||
|
{
|
||||||
|
if(op1 == op2)
|
||||||
|
{
|
||||||
|
alu_result = cur_pc + imm;
|
||||||
|
EX_IF_Latch.setIF_enable(true);
|
||||||
|
EX_IF_Latch.setPC(alu_result);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
case bne:
|
||||||
|
{
|
||||||
|
if(op1 != op2)
|
||||||
|
{
|
||||||
|
alu_result = cur_pc + imm;
|
||||||
|
EX_IF_Latch.setIF_enable(true);
|
||||||
|
EX_IF_Latch.setPC(alu_result);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
case blt:
|
||||||
|
{
|
||||||
|
if(op1 < op2)
|
||||||
|
{
|
||||||
|
alu_result = cur_pc + imm;
|
||||||
|
EX_IF_Latch.setIF_enable(true);
|
||||||
|
EX_IF_Latch.setPC(alu_result);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
case bgt:
|
||||||
|
{
|
||||||
|
if(op1 > op2)
|
||||||
|
{
|
||||||
|
alu_result = cur_pc + imm;
|
||||||
|
EX_IF_Latch.setIF_enable(true);
|
||||||
|
EX_IF_Latch.setPC(alu_result);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
case end:
|
||||||
|
{
|
||||||
|
Simulator.setSimulationComplete(true);
|
||||||
|
}
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
EX_MA_Latch.setALUResult(alu_result);
|
||||||
|
EX_MA_Latch.setInstruction(OF_EX_Latch.getInstruction());
|
||||||
|
EX_MA_Latch.setMA_enable(true);
|
||||||
|
OF_EX_Latch.setEX_enable(false);
|
||||||
|
}
|
||||||
|
}
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,12 +1,18 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
|
import generic.Instruction;
|
||||||
|
|
||||||
public class MA_RW_LatchType {
|
public class MA_RW_LatchType {
|
||||||
|
|
||||||
boolean RW_enable;
|
boolean RW_enable;
|
||||||
|
int aluResult;
|
||||||
|
int load_result;
|
||||||
|
Instruction instruction;
|
||||||
|
|
||||||
public MA_RW_LatchType()
|
public MA_RW_LatchType()
|
||||||
{
|
{
|
||||||
RW_enable = false;
|
RW_enable = false;
|
||||||
|
|
||||||
}
|
}
|
||||||
|
|
||||||
public boolean isRW_enable() {
|
public boolean isRW_enable() {
|
||||||
|
@ -17,4 +23,27 @@ public class MA_RW_LatchType {
|
||||||
RW_enable = rW_enable;
|
RW_enable = rW_enable;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
public void setALU_result(int alu_result) {
|
||||||
|
this.aluResult = alu_result;
|
||||||
|
}
|
||||||
|
|
||||||
|
public int getALU_result() {
|
||||||
|
return aluResult;
|
||||||
|
}
|
||||||
|
|
||||||
|
public void setLoad_result(int load_result) {
|
||||||
|
this.load_result = load_result;
|
||||||
|
}
|
||||||
|
|
||||||
|
public int getLoad_result() {
|
||||||
|
return load_result;
|
||||||
|
}
|
||||||
|
|
||||||
|
public void setInstruction(Instruction instruction) {
|
||||||
|
this.instruction = instruction;
|
||||||
|
}
|
||||||
|
|
||||||
|
public Instruction getInstruction() {
|
||||||
|
return instruction;
|
||||||
|
}
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,6 +1,8 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
|
import generic.Instruction;
|
||||||
import processor.Processor;
|
import processor.Processor;
|
||||||
|
import generic.Instruction.OperationType;
|
||||||
|
|
||||||
public class MemoryAccess {
|
public class MemoryAccess {
|
||||||
Processor containingProcessor;
|
Processor containingProcessor;
|
||||||
|
@ -16,7 +18,28 @@ public class MemoryAccess {
|
||||||
|
|
||||||
public void performMA()
|
public void performMA()
|
||||||
{
|
{
|
||||||
//TODO
|
if(EX_MA_Latch.isMA_enable())
|
||||||
|
{
|
||||||
|
Instruction instruction = EX_MA_Latch.getInstruction();
|
||||||
|
int alu_result = EX_MA_Latch.getALUResult();
|
||||||
|
MA_RW_Latch.setALU_result(alu_result);
|
||||||
|
OperationType op_type = instruction.getOperationType();
|
||||||
|
if (op_type==OperationType.store)
|
||||||
|
{
|
||||||
|
int val_store = containingProcessor.getRegisterFile().getValue(
|
||||||
|
instruction.getSourceOperand1().getValue());
|
||||||
|
containingProcessor.getMainMemory().setWord(alu_result, val_store);
|
||||||
|
}
|
||||||
|
else if (op_type==OperationType.load)
|
||||||
|
{
|
||||||
|
int load_result = containingProcessor.getMainMemory().getWord(alu_result);
|
||||||
|
MA_RW_Latch.setLoad_result(load_result);
|
||||||
|
}
|
||||||
|
MA_RW_Latch.setInstruction(instruction);
|
||||||
|
MA_RW_Latch.setRW_enable(true);
|
||||||
|
EX_MA_Latch.setMA_enable(false);
|
||||||
|
|
||||||
|
}
|
||||||
}
|
}
|
||||||
|
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,14 +1,50 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
|
import generic.Instruction;
|
||||||
|
|
||||||
public class OF_EX_LatchType {
|
public class OF_EX_LatchType {
|
||||||
|
|
||||||
boolean EX_enable;
|
boolean EX_enable;
|
||||||
|
Instruction instruction;
|
||||||
|
int op1, op2, imm;
|
||||||
|
|
||||||
public OF_EX_LatchType()
|
public OF_EX_LatchType()
|
||||||
{
|
{
|
||||||
EX_enable = false;
|
EX_enable = false;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
public void setInstruction(Instruction instruction) {
|
||||||
|
this.instruction = instruction;
|
||||||
|
}
|
||||||
|
|
||||||
|
public Instruction getInstruction() {
|
||||||
|
return instruction;
|
||||||
|
}
|
||||||
|
|
||||||
|
public void setOp1(int op1) {
|
||||||
|
this.op1 = op1;
|
||||||
|
}
|
||||||
|
|
||||||
|
public int getOp1() {
|
||||||
|
return op1;
|
||||||
|
}
|
||||||
|
|
||||||
|
public void setOp2(int op2) {
|
||||||
|
this.op2 = op2;
|
||||||
|
}
|
||||||
|
|
||||||
|
public int getOp2() {
|
||||||
|
return op2;
|
||||||
|
}
|
||||||
|
|
||||||
|
public void setImm(int imm) {
|
||||||
|
this.imm = imm;
|
||||||
|
}
|
||||||
|
|
||||||
|
public int getImm() {
|
||||||
|
return imm;
|
||||||
|
}
|
||||||
|
|
||||||
public boolean isEX_enable() {
|
public boolean isEX_enable() {
|
||||||
return EX_enable;
|
return EX_enable;
|
||||||
}
|
}
|
||||||
|
@ -17,4 +53,5 @@ public class OF_EX_LatchType {
|
||||||
EX_enable = eX_enable;
|
EX_enable = eX_enable;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
||||||
}
|
}
|
||||||
|
|
|
@ -1,11 +1,17 @@
|
||||||
package processor.pipeline;
|
package processor.pipeline;
|
||||||
|
|
||||||
|
import java.util.Arrays;
|
||||||
|
|
||||||
|
import generic.Instruction;
|
||||||
import processor.Processor;
|
import processor.Processor;
|
||||||
|
import generic.Instruction.OperationType;
|
||||||
|
import generic.Operand;
|
||||||
|
|
||||||
public class OperandFetch {
|
public class OperandFetch {
|
||||||
Processor containingProcessor;
|
Processor containingProcessor;
|
||||||
IF_OF_LatchType IF_OF_Latch;
|
IF_OF_LatchType IF_OF_Latch;
|
||||||
OF_EX_LatchType OF_EX_Latch;
|
OF_EX_LatchType OF_EX_Latch;
|
||||||
|
static OperationType[] opTypes = OperationType.values();
|
||||||
|
|
||||||
public OperandFetch(Processor containingProcessor, IF_OF_LatchType iF_OF_Latch, OF_EX_LatchType oF_EX_Latch)
|
public OperandFetch(Processor containingProcessor, IF_OF_LatchType iF_OF_Latch, OF_EX_LatchType oF_EX_Latch)
|
||||||
{
|
{
|
||||||
|
@ -18,7 +24,79 @@ public class OperandFetch {
|
||||||
{
|
{
|
||||||
if(IF_OF_Latch.isOF_enable())
|
if(IF_OF_Latch.isOF_enable())
|
||||||
{
|
{
|
||||||
//TODO
|
int instruction = IF_OF_Latch.getInstruction();
|
||||||
|
Instruction instr = new Instruction();
|
||||||
|
String bin_instr = Integer.toBinaryString(instruction);
|
||||||
|
int opcode = Integer.parseInt(bin_instr.substring(0, 5), 2);
|
||||||
|
instr.setOperationType(opTypes[opcode]);
|
||||||
|
|
||||||
|
int R3_type_operators[] = {0,2,4,6,8,10,12,14,16,18,20};
|
||||||
|
int R2I_type_operators[] = {1,3,5,7,9,11,13,15,17,19,21,22,23,25,26,27,28};
|
||||||
|
int R1I_type_operators[] = {24,29};
|
||||||
|
|
||||||
|
// if (bin_instr.length() < 32) { // TODO: check if this is correct
|
||||||
|
// int diff = 32 - bin_instr.length();
|
||||||
|
// String zeros = "";
|
||||||
|
// for (int i = 0; i < diff; i++) {
|
||||||
|
// zeros += "0";
|
||||||
|
// }
|
||||||
|
// bin_instr = zeros + bin_instr;
|
||||||
|
// }
|
||||||
|
|
||||||
|
if (Arrays.asList(R3_type_operators).contains(opcode)){
|
||||||
|
Operand rs1 = new Operand();
|
||||||
|
Operand rs2 = new Operand();
|
||||||
|
Operand rd = new Operand();
|
||||||
|
rs1.setOperandType(Operand.OperandType.Register);
|
||||||
|
rs2.setOperandType(Operand.OperandType.Register);
|
||||||
|
rd.setOperandType(Operand.OperandType.Register);
|
||||||
|
|
||||||
|
rs1.setValue(Integer.parseInt(bin_instr.substring(5, 10), 2));
|
||||||
|
rs2.setValue(Integer.parseInt(bin_instr.substring(9, 14), 2));
|
||||||
|
rd.setValue(Integer.parseInt(bin_instr.substring(14, 19), 2));
|
||||||
|
|
||||||
|
int op1 = containingProcessor.getRegisterFile().getValue(rs1.getValue());
|
||||||
|
int op2 = containingProcessor.getRegisterFile().getValue(rs2.getValue());
|
||||||
|
|
||||||
|
OF_EX_Latch.setInstruction(instr);
|
||||||
|
OF_EX_Latch.setOp1(op1);
|
||||||
|
OF_EX_Latch.setOp2(op2);
|
||||||
|
instr.setDestinationOperand(rd);
|
||||||
|
instr.setSourceOperand1(rs1);
|
||||||
|
instr.setSourceOperand2(rs2);
|
||||||
|
}
|
||||||
|
else if (Arrays.asList(R2I_type_operators).contains(opcode)){
|
||||||
|
Operand rs1 = new Operand();
|
||||||
|
Operand rd = new Operand();
|
||||||
|
rs1.setOperandType(Operand.OperandType.Register);
|
||||||
|
rd.setOperandType(Operand.OperandType.Register);
|
||||||
|
|
||||||
|
rs1.setValue(Integer.parseInt(bin_instr.substring(5, 10), 2));
|
||||||
|
rd.setValue(Integer.parseInt(bin_instr.substring(14, 19), 2));
|
||||||
|
|
||||||
|
int imm = Integer.parseInt(bin_instr.substring(19, 32), 2); // TODO: 2's complement
|
||||||
|
|
||||||
|
int op1 = containingProcessor.getRegisterFile().getValue(rs1.getValue());
|
||||||
|
|
||||||
|
OF_EX_Latch.setInstruction(instr);
|
||||||
|
OF_EX_Latch.setImm(imm);
|
||||||
|
OF_EX_Latch.setOp1(op1);
|
||||||
|
|
||||||
|
instr.setDestinationOperand(rd);
|
||||||
|
instr.setSourceOperand1(rs1);
|
||||||
|
}
|
||||||
|
else if (Arrays.asList(R1I_type_operators).contains(opcode)){
|
||||||
|
Operand rd = new Operand();
|
||||||
|
rd.setOperandType(Operand.OperandType.Register);
|
||||||
|
rd.setValue(Integer.parseInt(bin_instr.substring(5, 10), 2));
|
||||||
|
|
||||||
|
instr.setDestinationOperand(rd);
|
||||||
|
|
||||||
|
int imm = Integer.parseInt(bin_instr.substring(10, 32), 2); // TODO: 2's complement
|
||||||
|
|
||||||
|
OF_EX_Latch.setInstruction(instr);
|
||||||
|
OF_EX_Latch.setImm(imm);
|
||||||
|
}
|
||||||
|
|
||||||
IF_OF_Latch.setOF_enable(false);
|
IF_OF_Latch.setOF_enable(false);
|
||||||
OF_EX_Latch.setEX_enable(true);
|
OF_EX_Latch.setEX_enable(true);
|
||||||
|
|
|
@ -2,6 +2,8 @@ package processor.pipeline;
|
||||||
|
|
||||||
import generic.Simulator;
|
import generic.Simulator;
|
||||||
import processor.Processor;
|
import processor.Processor;
|
||||||
|
import generic.Instruction;
|
||||||
|
import generic.Instruction.OperationType;
|
||||||
|
|
||||||
public class RegisterWrite {
|
public class RegisterWrite {
|
||||||
Processor containingProcessor;
|
Processor containingProcessor;
|
||||||
|
@ -19,10 +21,29 @@ public class RegisterWrite {
|
||||||
{
|
{
|
||||||
if(MA_RW_Latch.isRW_enable())
|
if(MA_RW_Latch.isRW_enable())
|
||||||
{
|
{
|
||||||
//TODO
|
Instruction instruction = MA_RW_Latch.getInstruction();
|
||||||
|
OperationType op_type = instruction.getOperationType();
|
||||||
// if instruction being processed is an end instruction, remember to call Simulator.setSimulationComplete(true);
|
int alu_result = MA_RW_Latch.getALU_result();
|
||||||
|
|
||||||
|
if (op_type==OperationType.load)
|
||||||
|
{
|
||||||
|
int load_result = MA_RW_Latch.getLoad_result();
|
||||||
|
int rd = instruction.getDestinationOperand().getValue();
|
||||||
|
containingProcessor.getRegisterFile().setValue(rd, load_result);
|
||||||
|
}
|
||||||
|
else if (op_type==OperationType.end)
|
||||||
|
{
|
||||||
|
Simulator.setSimulationComplete(true);
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
if (op_type!=OperationType.store && op_type!= OperationType.jmp && op_type!= OperationType.beq && op_type!=OperationType.bne && op_type!=OperationType.blt && op_type!=OperationType.bgt)
|
||||||
|
{
|
||||||
|
int rd = instruction.getDestinationOperand().getValue();
|
||||||
|
rd = instruction.getDestinationOperand().getValue();
|
||||||
|
containingProcessor.getRegisterFile().setValue(rd, alu_result);
|
||||||
|
}
|
||||||
|
}
|
||||||
MA_RW_Latch.setRW_enable(false);
|
MA_RW_Latch.setRW_enable(false);
|
||||||
IF_EnableLatch.setIF_enable(true);
|
IF_EnableLatch.setIF_enable(true);
|
||||||
}
|
}
|
||||||
|
|
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